【基于FPGA的图像处理工程】边缘检测工程之Ascii转十六进制模块代码解析
【基于FPGA的图像处理工程】 —边缘检测工程：Ascii转十六进制模块代码解析作者：小黑同学 本文为明德扬原创文章，转载请注明出处！ Ascii转十六进制模块的功能：将ASCII所对应的16进制数，转成实质的16进制数。 一、设计架构上图是Ascii码表对应的数据。我们从图中可以获取到如下关键信息。 1. Ascii码0~9对应的十六进制数为8’h30~8’h39，也就是说收到ASCII码的16进制数8’h30~8’h39时，就转成0~9，也就是减去8’h30。 2. Ascii码A~F对应的十六进制数为8’h41~8’h46，也就是说收到ASCII码的16进制数8’h41~8’h46时，就转成A~F，也就是减去8’h37。 3. Ascii码a~f对应的十六进制数为8’h61~8’h66，也就是说收到ASCII码的16进制数8’h61~8’h66时，就转成a~f，也就是减去8’h57。 本模块的功能，是对ASCII码的0~9，a~f，A~F进行转换，其他数据不转换，不在此范围的，数据无效。例如： 当din=8’h31（字符1）,且din_vld = 1，则dout=4’h1,dout_vld=1; 当din=8’h41（大写字母A）时，且din_vld=1，则dout=4‘d10，dout_vld=1; 如果输入的ASCII不在数字0~9，A~F,a~f的时候，dout_vld就输出0。 当din=8’h49（大写字母I）时，且din_vld=1，则dout=0，dout_vld=0。
二、信号的意义
信号类型意义
clk输入信号时钟信号。
rst_n输入信号复位信号，低电平有效。
din输入信号接收的Ascii码数据，位宽为8bit。
din_vld输入信号输入数据有效指示信号，1bit位宽，当其为高电平时，对应输入数据有效，表示接收到一字节的数据。注意，一个时钟的高电平表示接收到一字节数据。
dout输出信号Ascii码转化为十六进制数之后的输出，位宽为4bit。
dout_vld输出信号输出数据有效指示信号，1bit位宽，当输入在红框范围内时，dout_vld为高电平，表示Ascii转十六进制转化成功，当输入不再红框范围内时，则dout_vld为低电平，表示数据无效。
三、参考代码 下面展出本模块的设计，欢迎进一步交流，如果需要源代码，欢迎与本人联系。 module acsii2hex(
clk ,
rst_n ,
din ,
din_vld,
dout ,
dout_vld
);
parameter DIN_W = 8;
parameter DOUT_W = 4;
input clk ;
input rst_n ;
input din ;
input din_vld ;
wire din ;
wire din_vld ;
outputdout ;
output dout_vld ;
reg dout ;
reg dout_vld ;
always@(posedge clk or negedge rst_n)begin
if(rst_n==1'b0)begin
dout_vld <= 0;
end
else if(din_vld&&((din>=8'd48&&din<8'd58)||(din>=8'd65&&din<8'd71)||(din>=8'd97&&din<8'd103)))begin
dout_vld <= 1;
end
else begin
dout_vld <= 0;
end
end
always@(posedge clk or negedge rst_n)begin
if(rst_n==1'b0)begin
dout <= 0;
end
else if(din>=8'd48&&din<8'd58) begin
dout <= din - 8'd48;
end
else if(din>=8'd65&&din<8'd71) begin
dout <= din - 8'd55;
end
else if(din>=8'd97&&din<8'd103) begin
dout <= din - 8'd87;
end
else begin
dout <= 0;
end
end
endmodule
明德扬专注FPGA研究，我司正在连载两本书籍：《基于FPGA至简设计法实现的图像边缘检测系统》（http://www.fpgabbs.cn/forum.php?mod=viewthread&tid=691）、《ASIC和FPGA时序约束理论与应用》（http://www.fpgabbs.cn/forum.php?mod=viewthread&tid=705），有兴趣点击观看。也欢迎加入群（838209674），及时获取最新的文章信息，整个边缘检测工程源代码可加Q:1817866119（N老师）获取！
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